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CAT28C512/513
DEVICE OPERATION
Read
Data stored in the CAT28C512/513 is transferred to the
data bus when WE is held high, and both OE and CE
are held low. The data bus is set to a high impedance
state when either CE or OE goes high. This 2-line control
architecture can be used to eliminate bus contention in
a system environment.
Figure 3. Read Cycle
tRC
ADDRESS
tCE
CE
tOE
OE
VIH
Byte Write
A write cycle is executed when both CE and WE are low,
and OE is high. Write cycles can be initiated using either
WE or CE , with the address input being latched on the
falling edge of WE or CE , whichever occurs last. Data,
conversely, is latched on the rising edge of WE or CE ,
whichever occurs first. Once initiated, a byte write cycle
automatically erases the addressed byte and the new
data is written within 5 ms.
WE
tLZ
tOHZ
tOLZ
tOH
tHZ
DATA OUT
HIGH-Z
DATA VALID
DATA VALID
tAA
Figure 4. Byte Write Cycle [WE Controlled]
tWC
ADDRESS
CE
OE
tAS
tCS
tAH
tCH
tOES
tWP
tOEH
WE
tBLC
DATA OUT
DATA IN
HIGH-Z
DATA VALID
tDS
tDH
Doc. No. MD-1007, Rev. I
6
? 2009 SCILLC. All rights reserved.
Characteristics subject to change without notice
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